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17.4版本的OrCAD中,如何批量修改原理图里边的器件封装或其他器件属性呢?

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#嵌入式硬件#硬件工程
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17.4版本的OrCAD中,Design Rules Check(DRC)的使用?

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为什么RAM在读操作时,需要在前一个时钟的上升沿先读出地址,然后在下一个时钟的上升沿才输出数据呢?(读延时)

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#fpga开发#嵌入式硬件
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