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FPGA学习篇——Verilog学习之“有限状态机FSM”

Verilog中case语句不加default的影响_verilog case default-CSDN博客见这个博主的文章,写的很清楚。

#fpga开发#学习
CAN总线通信协议学习5——数据链路层之错误处理机制

其实没有这个错误处理机制CAN总线也能实现完整的收发操作,但CAN总线发生错误时有一定的处理机制会比较好。

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#学习#网络
到底了