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VerilogA采样保持电路模型
改进了采样保持电路VerilogA代码,使其支持模拟沟道电荷注入效应

基于伪随机数LFSR和Box Muller变换的可综合的高斯白噪声FPGA生成器,AD/DA回环输出采集HDMI显示(已通过matlab、仿真和板级验证)
基于XLINX公司生产的AX7035开发板,具有HDMI输出输出,可以满足在没有示波器条件下输入输出回环测试。项目中高斯白噪声生成模块仅使用了ROM ip核用来存储查找表计算根号、对数、cos、sin,可以移植到其他任意开发中。

使用matlab制作音乐
使用matlab生成声音,其中对包络函数进行了修改和创新
到底了