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VCS时序后仿真——设置特定instance不做时序检查

1. 一种方式是通过tcheck instance_name -xgen -disable,在sim的ucli tcl中运行,可以将不需要时序检查的violation cell不产生X而影响到时序后仿真的结果,但log中依旧会报告有时序Timing violation。2. 这里重点讲的是另一种方式,可以对特定instance设置不检查时序timing check。首先,在vcs 命令加一个+op

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