logo
publist
写文章

简介

该用户还未填写简介

擅长的技术栈

可提供的服务

暂无可提供的服务

Tessent mbist加一条TCK的bist_clk时钟通路方便debug

bist_clk实质是Memory clk中的一路clock,即bist_clk是选的memory clk中的一个,所以这个mux是插在memory clk上面的,可能会影响到memory的clock delay从而影响memory性能。插入的tessent_persistent_cell_tck_mux_*_inst,可以指定其插在port上,也可以说buf或者ckcell的output pin

#fpga开发#基带工程#云计算 +2
到底了