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这在 Vivado 中遇到 **“Declarations not allowed in unnamed block“** 错误时

块中不允许包含任何变量声明。Verilog 的标准要求,在 always。块内还有一些变量声明,正是这部分导致了报错。块内只能进行逻辑运算和赋值,而不能包含声明。在 Vivado 中遇到。和类似声明是无效的,因为 always。错误时,确实是因为在 always。块外部,并且 always。在 always @(*)块只用于赋值和操作。

#fpga开发
这在 Vivado 中遇到 **“Declarations not allowed in unnamed block“** 错误时

块中不允许包含任何变量声明。Verilog 的标准要求,在 always。块内还有一些变量声明,正是这部分导致了报错。块内只能进行逻辑运算和赋值,而不能包含声明。在 Vivado 中遇到。和类似声明是无效的,因为 always。错误时,确实是因为在 always。块外部,并且 always。在 always @(*)块只用于赋值和操作。

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