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面经及部分答案:英伟达实习生面试 ASIC PD岗面经系列:2020年英伟达ASIC PD岗
公众号数字ICer的面经
Scan chain/SE,SI,SO 带scan的寄存器
芯片设计制造全过程将一颗芯片从0到1,可以分为芯片设计和芯片制造两部分。芯片设计对应市场上一些fabless公司,这类公司只做芯片设计。而芯片制造对应的是foundary,比如国内的smic,TSMC,国外的Samsung,GlobalFoundary(GF),常说的光刻机,N5,N7工艺相关。1.芯片设计芯片设计有主要分为四个过程:规格定义,系统设计,前端设计(coding),后端设计(物理设计
Setup time和Hold time对芯片主频的影响Setup time和Hold time对芯片主频的影响有同学问到这个问题,列出自己的一些看法。Setup time和Holdup time这边对于建立时间和保持时间的概念不再赘述,后续会出一期专文,介绍setup time和hold time,以及他们的violation如何处理。"setup time”:建立时间,通过对电路的时序分析可以
Setup time和Hold time对芯片主频的影响Setup time和Hold time对芯片主频的影响有同学问到这个问题,列出自己的一些看法。Setup time和Holdup time这边对于建立时间和保持时间的概念不再赘述,后续会出一期专文,介绍setup time和hold time,以及他们的violation如何处理。"setup time”:建立时间,通过对电路的时序分析可以
芯片设计制造全过程将一颗芯片从0到1,可以分为芯片设计和芯片制造两部分。芯片设计对应市场上一些fabless公司,这类公司只做芯片设计。而芯片制造对应的是foundary,比如国内的smic,TSMC,国外的Samsung,GlobalFoundary(GF),常说的光刻机,N5,N7工艺相关。1.芯片设计芯片设计有主要分为四个过程:规格定义,系统设计,前端设计(coding),后端设计(物理设计
DC改变了RTL代码的结构,但是逻辑没有改变。比如很调整组合逻辑的位置,但是最终的功能是一样的。文件的后缀名为.svf,该文件用于后面的形式验证,即formalitydont touch:不会穿过logic,可以用于cells, nets, references, 和 designs。你不希望DC优化的地方,都可以用它。main.tcl:1.目录建立设置报告目录 …/rpt/$pro设置输出目录…
IR_drop分析







