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    1985年赛灵思（XILINX，后被AMD收购）创始人推出全球首颗FPGA“XC2064”，40年后这颗只有64个逻辑块、不足千门电路的芯片却成了驱动边缘AI的算力引擎之一。

    当初的 FPGA充当标准芯片间的粘合剂，用于接口桥接，不仅速度慢、容量小、价格还贵，主要服务军工和通信巨头。后来90nm、65nm制程普及，FPGA容量与性能跃升，赛灵思和Altera便把ARM硬核处理器集成到FPGA，诞生了SoC FPGA。这种“处理器+可编程逻辑”的组合进入了工控、汽车电子等核心领域。

    2010年后深度学习兴起，FPGA变得更香了，高并行、低延迟、可重配置，比GPU功耗低，比ASIC灵活，很适配边缘AI推理，FPGA厂商纷纷推出AI专用开发套件和加速库抢占市场。

    到了2026年，FPGA竞争焦点已经从能跑AI转向性能的极限榨取和物理形态的极限压缩——FPGA行业的两大势力Altera和Efinix相继发布新品，前者重塑软件范式，使AI推理速度提升28倍，后者重构硬件底层，将功耗减半、体积缩减60%。

Altera：把FPGA变快

    今年4月30日，Altera发布FPGA AI套件26.1.1，核心更新是空间编译模式。

    传统方式下FPGA运行AI模型采用序列模式，如同通用处理器通过微代码调度执行任务，有资源开销和延迟。然而空间模式则针对神经网络模型直接生成专用RTL硬件电路，明显降低推理延迟。据Altera官方数据，在特定MLP基准测试中：

    →资源占用：序列模式28,000个ALMs，空间模式仅6,000个ALMs，缩减至前者的1/5。

    →推理速度：序列模式11万样本/秒，空间模式309万样本/秒，提升28倍。

Efinix：把FPGA变小

     今年6月9日，Efinix（前赛灵思高管创办，自研XLR架构）发布Titanium Edge系列FPGA，专注边缘AI对功耗、尺寸、安全性的极致要求。

    传统FPGA的逻辑单元与布线通道比例固定，容易造成资源浪费。Efinix的XLR（可互换逻辑布线）单元可根据布线需求在编译时灵活配置为计算逻辑或信号通道，大幅提升资源利用率。据Efinix官方数据：

    →体积：SiP封装将FPGA、内存、闪存集成于一体，PCB面积缩减60%，最小尺寸5.5mm×5.5mm，可置于眼镜腿或胶囊内窥镜中。

    →功耗：静态功耗较上代降低50%，适配电池供电设备。

    →连接：支持2.5Gbps I/O和x8通道MIPI，可同时处理多路高清传感器数据。

    →安全：前瞻性地集成硬件级后量子密码学方案，并内置SEU（单粒子翻转）纠错引擎，能抵抗辐射引发的计算错误，大幅提升芯片在工业、汽车等恶劣环境下的可靠性。

    国内FPGA则在AI视觉、异构计算等赛道追赶，缩小差距。如上海交大团队的ASP-DAC 2026边缘LLM推理加速器，仅用FPGA一半资源、15W功耗，实现120 tokens/s吞吐量，部分任务达NVIDIA A100（FP16）的2.7倍。京微齐力飞马视觉系列HME-PV65，集成约65,000个逻辑单元，支持主流高速传感器接口，可直接对接工业相机、车载摄像头等高分辨率传感器。

    说到底，FPGA在边缘AI的牌局已经翻到新一页，不再拼架构概念，而是把功耗、体积都压到极限，然而量产线不问架构优劣，良率、散热、工具链顶不顶得住才是最终考验。

说明：1.本文参考公开报道并借助AI工具进行整理和分析，如有不妥之处欢迎指正。2.部分市场数据基于行业估算、发布以及官方报道，具体精确数据请以权威机构为准。3.欢迎长期追踪边缘AI的朋友一起探讨。