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对于编写的systemverilog代码，在linux下，可以使用vcs编译，但是编译的时候，要注意，要加入几个选项。整个过程，linux使用的是64位的redhat，vcs使用的是vcs2015，verdi使用的是verdi2015。如以下的systemverilog代码。其中router_test_top.sv是顶层的代码。使用命令。执行完毕后，就会生成 simv了。但是别忘记要执行以下sim

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